Localidad estructural, criterio de división para la ejecución de Redes de Petri no autónomas en IP-Core
Fil: Micolini, Orlando. Universidad Nacional de Córdoba. Facultad de Ciencias Exactas, Físicas y Naturales. Laboratorio de Arquitectura de Computadoras; Argentina.
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2024
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author | Micolini, Orlando Cebollada y Verdaguer, Marcelo Ventre, Luis Orlando |
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description | Fil: Micolini, Orlando. Universidad Nacional de Córdoba. Facultad de Ciencias Exactas, Físicas y Naturales. Laboratorio de Arquitectura de Computadoras; Argentina. |
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id | rdu-unc.552086 |
institution | Universidad Nacional de Cordoba |
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publishDate | 2024 |
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spelling | rdu-unc.5520862024-05-30T12:04:21Z Localidad estructural, criterio de división para la ejecución de Redes de Petri no autónomas en IP-Core Micolini, Orlando Cebollada y Verdaguer, Marcelo Ventre, Luis Orlando Procesador de Petri Arquitectura de computadoras FPGA Ingeniería en Computación Fil: Micolini, Orlando. Universidad Nacional de Córdoba. Facultad de Ciencias Exactas, Físicas y Naturales. Laboratorio de Arquitectura de Computadoras; Argentina. Fil: Cebollada y Verdaguer, Marcelo. Universidad Nacional de Córdoba. Facultad de Ciencias Exactas, Físicas y Naturales. Laboratorio de Arquitectura de Computadoras; Argentina. Fil: Ventre, Luis Orlando. Universidad Nacional de Córdoba. Facultad de Ciencias Exactas, Físicas y Naturales. Laboratorio de Arquitectura de Computadoras; Argentina. Este trabajo propone un nuevo concepto, localidad estructural, para dividir y representar redes de Petri no autónomas con el fin de reducir de forma significativa los recursos de hardware de los IP-Core que las ejecutan. Con la consecuente ventaja de lograr asi abordar problemas de mayor tamaño. Las redes así expresadas dan origen a un algoritmo de ejecución que preserva el modelo original y facilita el paralelismo. En este trabajo se expone un caso de aplicación donde se manifiestan las ventajas de la localidad estructural aplicada a una red de Petri con diferentes semánticas temporales y tipos de brazos, obteniendo una disminución de recursos en la FPGA que implementa el IP-Core. http://sedici.unlp.edu.ar/handle/10915/50484 Fil: Micolini, Orlando. Universidad Nacional de Córdoba. Facultad de Ciencias Exactas, Físicas y Naturales. Laboratorio de Arquitectura de Computadoras; Argentina. Fil: Cebollada y Verdaguer, Marcelo. Universidad Nacional de Córdoba. Facultad de Ciencias Exactas, Físicas y Naturales. Laboratorio de Arquitectura de Computadoras; Argentina. Fil: Ventre, Luis Orlando. Universidad Nacional de Córdoba. Facultad de Ciencias Exactas, Físicas y Naturales. Laboratorio de Arquitectura de Computadoras; Argentina. Otras Ingeniería Eléctrica, Ingeniería Electrónica e Ingeniería de la Información 2024-05-29T12:00:04Z 2024-05-29T12:00:04Z 2015 conferenceObject 978-987-3724-37-4 http://hdl.handle.net/11086/552086 spa Attribution-NonCommercial-ShareAlike 4.0 International http://creativecommons.org/licenses/by-nc-sa/4.0/ Impreso; Electrónico y/o Digital |
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